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<?xml version="1.0"?>
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<!--Product Version: PlanAhead v14.7 (64-bit)-->
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<Project Version="4" Minor="36">
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<FileSet Dir="sources_1" File="fileset.xml"/>
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<FileSet Dir="constrs_1" File="fileset.xml"/>
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<FileSet Dir="sim_1" File="fileset.xml"/>
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<RunSet Dir="runs" File="runs.xml"/>
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<DefaultLaunch Dir="$PRUNDIR"/>
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<DefaultPromote Dir="$PROMOTEDIR"/>
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<Config>
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<Option Name="Id" Val="45689c7b25ae425b84c8ab3f166c9430"/>
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<Option Name="Part" Val="xa6slx4csg225-3"/>
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<Option Name="CompiledLibDir" Val="$PCACHEDIR/compile_simlib"/>
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<Option Name="TargetLanguage" Val="Verilog"/>
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<Option Name="TargetSimulator" Val="ISim"/>
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<Option Name="Board" Val=""/>
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<Option Name="SourceMgmtMode" Val="All"/>
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<Option Name="ActiveSimSet" Val="sim_1"/>
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<Option Name="CxlOverwriteLibs" Val="1"/>
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<Option Name="CxlFuncsim" Val="1"/>
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<Option Name="CxlTimesim" Val="1"/>
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<Option Name="CxlCore" Val="1"/>
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<Option Name="CxlEdk" Val="0"/>
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<Option Name="CxlExcludeCores" Val="1"/>
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<Option Name="CxlExcludeSubLibs" Val="0"/>
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</Config>
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</Project>
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